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Delay models and design guidelines for MCML gates with resistor or PMOS load
pubblicato su:
MICROELECTRONICS JOURNAL - 2020
Centurelli F.
,
Scotti G.
,
Trifiletti A.
, Palumbo G.
© Università degli Studi di Roma "La Sapienza" - Piazzale Aldo Moro 5, 00185 Roma